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时钟集成电路; 抖动性能; 输出速度; IC; RF; ADI; 压控振荡器; 信号处理;
机译:具有非累积参考时钟抖动的二阶数字Bang-Bang锁相环的输出抖动性能
机译:TI推出用于PCI Express Gen3的低抖动时钟缓冲器IC
机译:用于高性能低功耗CTΣΔ调制器时钟抖动不敏感多维测DAC架构的时钟抖动不敏感多维测架构的设计问题和性能限制
机译:具有宽锁定范围的低抖动锁相环时钟合成。
机译:具有能量收集功能的敏捷的阻滞器和时钟抖动容限低功率频率选择接收器
机译:具有非累积参考时钟抖动的二阶数字Bang-bang锁相环的输出抖动性能
机译:具有抖动时钟的Delta调制的扩频数据通信系统的设计与性能。
机译:用于ADI的设备-通过电信的pecurso传输信号到 u00c4ticos以及从 u00c4ticos撤回信号-多通道 u00c6o u00c4tica来传输 u00c6o信号并处理ADI的撤回snais u00c4ticos
机译:带有时钟抖动的数字控制振荡器的最佳抖动,用于增益和带宽控制
机译:带有时钟抖动的数控振荡器的最佳抖动,用于增益和带宽控制
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