Dipt. Arquitectura de Comput., Univ. Complutense de Madrid, Madrid, Spain;
field programmable gate arrays; 3D FPGA resource management; 3D IC technologies; 3D fragmentation metric; 3D reconfigurable resources; hardware multitasking; vertex-list structure;
机译:基于FPGA高性能电脑硬件的人工智能企业人力资源管理系统
机译:有效的资源管理,可优化RVC框架中FPGA上硬件任务的放置
机译:新的三级资源管理可提高FPGA上离线硬件任务放置的质量
机译:3D FPGA资源管理和硬件多任务处理的碎片度量
机译:用于FPGA的半流式卷积神经网络硬件架构的层型专业处理引擎
机译:基于FPGA的高精度时差信息提取方法及其硬件电路的实现
机译:一种新的三维部分可重构FpGa在线硬件任务调度和布局算法