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Compact on-chip wire models for the clock distribution of high-speed I/O interfaces

机译：紧凑的片上线模型，用于高速I / O接口的时钟分配

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来源
《Electrical Performance of Electronic Packaging, 2008 IEEE-EPEP》||P.235-238|共4页
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作者
Qi Xiaoning; Kim Joong-Ho; Yang Ling; Schmitt Ralf; Yuan Chuck;
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正文语种
中图分类工业技术;
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