CMOS digital integrated circuits; amplifiers; analogue-digital conversion; interpolation; CMOS; digital interpolation; digitally interpolated pipelined-SAR ADC; gain variation; interstage gain requirement; open-loop dynamic amplifier; power 0.48 mW; residue amplifier; size 65 nm; supply voltage scaling; voltage 0.5 V to 1 V; word length 9 bit; CMOS integrated circuits; Clocks; Gain; Interpolation; Power demand; Prototypes; Robustness;
机译:0.7 V 12b 160ms / s 12.8fj / conv。 使用数字放大器技术的28nm CMOS的无校准管道-SAR ADC
机译:0.7 V 12b 160ms / s 12.8fj / conv。 使用数字放大器技术的28nm CMOS的无校准管道-SAR ADC
机译:具有PVT不敏感和增益折叠动态放大器的12位100 - MS / S管道ADC
机译:使用动态放大器0.5至1V 9位15至90 MS / S数字内插的流水线ADC
机译:具有无源残留转移和动态放大器的高速和低功率流水线SAR ADC
机译:用于数字微机械振动陀螺仪的高动态范围开关电容Sigma-Delta ADC
机译:一个12位200 ms / s流水线-SAR ADC,用于级际增益