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A Leakage Management System Based on Clock Gating Infrastructure for a 65-nm Digital Base-Band Modem Chip

机译：一种基于时钟门控漏光基础设施的泄漏管理系统，用于65纳米数字源源型磁带调制解调器芯片

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In this paper we present a leakage management system which takes advantage of the existing clock gating infrastructure. This methodology avoids both RTL and software changes, at the block and chip level. We illustrate this approach with a 65-nm digital ba

机译：在本文中，我们提出了一种泄漏管理系统，该系统利用现有的时钟门控基础设施。该方法避免了块和芯片级别的RTL和软件更改。我们用65 nm数字ba说明了这种方法

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来源
《IEEE Symposium on VLSI Technology》|2006年||共2页
会议地点
作者
F. Jumel; P. Royannez; H. Mair; D. Scott; A.E. Rachidi; R. Lagerquist; M. Chau; S. Gururajarao; S. Thiruvengadam; M. Clinton; V. Menezes; R. Hollingsworth; J. Vaccani; F. Piacibello; N. Culp; J. Rosal; M. Ball; F. Ben-Amar; L. Bouetel; O. Domerego; . La;
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会议组织
原文格式 PDF
正文语种
中图分类 TN47-53;
关键词
electrical faults; integrated circuit testing; modems; 65 nm; RTL; clock gating infrastructure; digital base band modem chip; leakage management system; wireless SoC;

机译：电气故障;集成电路测试;调制解调器;65nm;RTL;时钟门控基础设施;数字基带调制解调器芯片;泄漏管理系统;无线SOC;

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