机译:使用基于动态CMOS逻辑的新型4晶体管XOR / XNOR门的高速14晶体管全加器单元
机译:使用8个晶体管和新颖的3个晶体管XNOR门的一位全加法器设计
机译:利用垂直狭缝场效应晶体管(VESFET)的独立控制双栅极功能,可调节阈值的电路设计
机译:具有GDI单元和独立双栅极晶体管的完整加法器设计
机译:独立双栅极SOI MOSFET晶体管泄漏电流的仿真分析。
机译:双栅三有源层沟道用于AMOLED像素电路的IGZO薄膜晶体管的设计与分析
机译:单比特全加法器设计使用8个晶体管和新颖的3晶体管XNOR门