DRAM chips; delay lock loops; double data rate; coded phase blending; DRAM; delay locked loop; duty cycle correction; 0.11 micron;
机译:具有DDR DRAM应用逐次逼近寄存器的0.31–1 GHz快速校正占空比校正器
机译:具有宽占空比校正范围的全数字占空比校正器,适用于DRAM应用
机译:用于DRAM接口的正交时钟校正器,具有基于弛豫振荡器的占空比和正交相位检测器
机译:使用CODED相位混合方案的内置占空比校正器,用于DDR / DDR2同步DRAM应用
机译:异步和同步光纤代码分割多址局域网的编码方案。
机译:高损耗比和低占空比无线传感器网络的代码分发方案中的长寿命延迟和传输时间最小化
机译:1用于空间任务的片上DRam应用的高效纠错码