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Flip-around结构高速采样保持电路的设计

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本文分析了Flip-around结构采样保持电路产生失真的原因,采用增加哑开关管的自举开关消除与输入有关的电荷注入和时钟馈通;采用增益增强技术提高运算放大器直流增益,并通过调整辅助运放的负载电容大小实现主运放建立时间特性的优化.文章设计出一个Flip-around结构的高速采样保持电路,使用Hspice对电路各个模块进行了功能仿真,给出了整个采样保持电路的仿真结果.

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来源
《第十四届全国半导体集成电路、硅材料学术年会》|2005年|329-333|共5页
会议地点北京
作者
朱建培; 姚若河; 张炜华; 吴为敬;
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作者单位

中国电子学会;

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会议组织
正文语种
原文格式 PDF
中图分类设计、分析、计算;
关键词
数模转换; 采样保持; 电路设计;
入库时间 2022-08-17 10:49:41

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