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尚会滨; 张晓林;
中国电子学会;
数字集成电路; 时钟树综合; 优化设计; 计算方法;
机译:<![CDATA [可扩展的 < MML:MROW> α MML:MI> MML:MROW> MML:MATH> -Power定律MOSFET模型,用于超深亚微米数字集成电路设计的表征]]]>
机译:时钟树发生器可满足高速深亚微米设计的需求
机译:优化设计时序:芯片上的变化,时钟门控和现代数字设计的时钟网络的复杂性使过时的时钟树综合(CTS)方法失效
机译:时钟数据补偿感知时钟树在具有自适应时钟生成的数字电路中的综合
机译:深亚微米集成电路设计中的串扰噪声。
机译:幼儿中的数字单词用法与七岁时的数字回忆性能相关
机译:ASIC后端设计中的时钟树综合
机译:三模冗余同步架构中实现单源冗余时钟树时竞争条件的影响。
机译:集成时钟树综合和时序优化的集成电路设计方法
机译:用于产生和维护用于深亚微米集成电路设计的电建模数据的方法和装置
机译:提取和存储用于深亚微米集成电路设计的连接性和几何数据的方法和装置
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