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Plus five and invert algorithm

机译:加五反算法

摘要

A four bit binary coded decimal (BCD) up/down counter includes a four bit adder and associated logic circuitry configured to feed therethrough the incoming BCD code words as the actual output for the up count and for the down count, add binary 5 to the incoming BCD code word for 1 through 9 and invert each bit of the resulting code words, and feeding the BCD code word for zero directly to the output.
机译:一个四位二进制编码的十进制(BCD)递增/递减计数器包括一个四位加法器和相关的逻辑电路,该逻辑电路配置为将传入的BCD码字馈入其中,作为递增计数和递减计数的实际输出,将二进制5加到输入1到9的BCD码字,并将得到的码字的每一位取反,然后将零的BCD码字直接馈送到输出。

著录项

  • 公开/公告号US3992611A

    专利类型

  • 公开/公告日1976-11-16

    原文格式PDF

  • 申请/专利权人 MOTOROLA INC.;

    申请/专利号US19750569900

  • 发明设计人 TIM W. HENRY;

    申请日1975-04-21

  • 分类号G06M3/14;

  • 国家 US

  • 入库时间 2022-08-22 23:38:07

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