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COMPUTER-AIDED DESIGN METHODS AND APPARATUS FOR MULTILEVEL INTERCONNECT TECHNOLOGIES

机译:多级互连技术的计算机辅助设计方法和装置

摘要

Data processing methods and computer display systems for computer aided design and electrical performance prediction of multilevel on-chip and off-chip interconnects. The invention specifically relates to parameterized graphical display and computation tools for calculation and display of capacitance and other electrical characteristics of multilevel VLSI, PCB, and MCM interconnects. Four subsystems are integrated: (a) a batch-mode computation module that combines a 2-D/3-D finite difference numerical simulation and a fast interpolation algorithm; (b) an interactive design mode with performance browsing, goal-directed synthesis, and on-line performance evaluation; (c) an interactive SPICE subcircuit generator and simulator; and (d) a spreadsheet-style graphical user interface.
机译:用于计算机辅助设计和多层片上和片外互连的电气性能预测的数据处理方法和计算机显示系统。本发明具体地涉及用于多级VLSI,PCB和MCM互连的电容和其他电特性的计算和显示的参数化图形显示和计算工具。集成了四个子系统:(a)批处理模式计算模块,结合了2-D / 3-D有限差分数值模拟和快速插值算法; (b)具有性能浏览,目标导向的综合和在线性能评估的交互式设计模式; (c)交互式SPICE子电路生成器和模拟器; (d)电子表格样式的图形用户界面。

著录项

  • 公开/公告号JPH07501906A

    专利类型

  • 公开/公告日1995-02-23

    原文格式PDF

  • 申请/专利权人

    申请/专利号JP19940500829

  • 发明设计人

    申请日1993-06-01

  • 分类号G06F17/50;

  • 国家 JP

  • 入库时间 2022-08-22 04:29:04

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