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Complementary clock pulse generator using CMOS technology

机译:使用CMOS技术的互补时钟脉冲发生器

摘要

A first transmit switch (2) contains an input (23), an output and two control terminals (21,22) for coupling the input and output terminals, when the input clock pulse signal (Clkin) has reached the first control terminal (21), and the inverted clock pulse signal from the first inverter (11) has reached the second control terminal (22). A second transmit switch (3) has two control terminals (31,32) for coupling its input (33) and output terminal (34) under similar conditions as for the first switch. The synonymous clock pulse signals (Clk) are obtained from the first switch output terminal, and the counterphase clock pulse signals (Clk) are derived from the second switch output terminal.
机译:当输入时钟脉冲信号(Clkin)到达第一控制端子(21)时,第一发送开关(2)包括输入(23),输出和两个用于耦合输入和输出端子的控制端子(21,22)。 ),并且来自第一反相器(11)的反相时钟脉冲信号已经到达第二控制端子(22)。第二发射开关(3)具有两个控制端子(31,32),用于在与第一开关类似的条件下耦合其输入(33)和输出端子(34)。从第一开关输出端子获得同义时钟脉冲信号(Clk),从第二开关输出端子获得反相时钟脉冲信号( Clk)。

著录项

  • 公开/公告号DE19624270A1

    专利类型

  • 公开/公告日1997-07-10

    原文格式PDF

  • 申请/专利权人 LG SEMICON CO. LTD. CHEONGJU KR;

    申请/专利号DE1996124270

  • 发明设计人 KIM DAE-JEONG SEOUL/SOUL KR;

    申请日1996-06-18

  • 分类号H03K5/151;H03F3/26;

  • 国家 DE

  • 入库时间 2022-08-22 03:14:46

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