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BiCMOS ESD circuit with subcollector/trench-isolated body mosfet for mixed signal analog/digital RF applications

机译:具有子集电极/沟槽隔离体MOSFET的BiCMOS ESD电路,用于混合信号模拟/数字RF应用

摘要

An ESD power clamp circuit provides ESD protection for semiconductor chips through a power clamping device. The power clamping device includes a FET and a bipolar element, formed in an isolation region, and a buried diffusion. The buried diffusion is used as a subcollector for the bipolar element, and is used as an isolation for the FET.
机译:ESD功率钳位电路通过功率钳位器件为半导体芯片提供ESD保护。功率钳位器件包括形成在隔离区域中的FET和双极元件以及掩埋扩散。掩埋扩散用作双极元件的子集电极,并用作FET的隔离。

著录项

  • 公开/公告号US6455902B1

    专利类型

  • 公开/公告日2002-09-24

    原文格式PDF

  • 申请/专利权人 INTERNATIONAL BUSINESS MACHINES CORPORATION;

    申请/专利号US20000731351

  • 发明设计人 STEVEN H. VOLDMAN;

    申请日2000-12-06

  • 分类号H01L297/20;

  • 国家 US

  • 入库时间 2022-08-22 00:48:09

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