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TEST DEVICE, TEST METHOD, TEST PROGRAM, FPGA AND CPLD

机译:测试装置,测试方法,测试程序,FPGA和CPLD

摘要

PPROBLEM TO BE SOLVED: To execute a connection test of channel device (CH) and peripheral processor (PCU) without using an expensive pseudo input and output processor (PIO) while improving the test efficiency and the coverage. PSOLUTION: This test device comprises a CH function achievement part achieving CH function and a CPU function achievement part achieving PCU function. (1) The CH function achievement part is operated in a non-test mode, and (2) when a switching instruction to a test mode is received, the CPU function achievement part is operated instead of the CH function achievement part. PCOPYRIGHT: (C)2008,JPO&INPIT
机译:

要解决的问题:在不使用昂贵的伪输入和输出处理器(PIO)的情况下执行通道设备(CH)和外围处理器(PCU)的连接测试,同时提高测试效率和覆盖范围。

解决方案:该测试设备包括实现CH功能的CH功能实现部分和实现PCU功能的CPU功能实现部分。 (1)CH功能实现部在非测试模式下操作,以及(2)当接收到测试模式的切换指令时,代替CH功能实现部,操作CPU功能实现部。

版权:(C)2008,日本特许厅&INPIT

著录项

  • 公开/公告号JP2008090776A

    专利类型

  • 公开/公告日2008-04-17

    原文格式PDF

  • 申请/专利权人 NEC CORP;

    申请/专利号JP20060273724

  • 发明设计人 MIYAZAKI GEN;

    申请日2006-10-05

  • 分类号G06F13/00;

  • 国家 JP

  • 入库时间 2022-08-21 20:23:31

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