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REFERENCE CIRCUIT AND METHOD FOR MITIGATING SWITCHING JITTER AND DELAY-LOCKED LOOP (DLL) USING SAME

机译:使用相同的缓解抖动和延迟锁定环(DLL)的参考电路和方法

摘要

A reference circuit and method for mitigating switching jitter and delay-locked loop (DLL) using same are provided. The reference circuit and method determine a number of steps of a fine delay line (FDL) that are equivalent to a step of a coarse delay line (CDL). Switching jitter of the DLL is reduced since the delay of the step of the CDL that is switched when on an underflow or overflow condition of the FDL is detected is equivalent to the delay of the provided number of steps of the FDL.
机译:提供了一种参考电路和使用其来减轻开关抖动和延迟锁定环(DLL)的方法。参考电路和方法确定与粗延迟线(CDL)的步骤等效的细延迟线(FDL)的步骤数。由于在检测到FDL的下溢或上溢条件时切换的CDL的步阶的延迟等于FDL提供的步数的延迟,因此可以减少DLL的切换抖动。

著录项

  • 公开/公告号EP2313976A1

    专利类型

  • 公开/公告日2011-04-27

    原文格式PDF

  • 申请/专利权人 MOSAID TECHNOLOGIES INCORPORATED;

    申请/专利号EP20090806260

  • 发明设计人 PETRIE WILLIAM;

    申请日2009-08-10

  • 分类号H03K5/135;H03K5/14;

  • 国家 EP

  • 入库时间 2022-08-21 17:54:35

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