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FAULT TREE ANALYSIS SYSTEM, FAULT TREE ANALYSIS METHOD AND PROGRAMME

机译:故障树分析系统,故障树分析方法和程序

摘要

The present invention is a fault tree analysis system which has a k/n gate logical conjunction elimination means for eliminating a logical conjunction that includes a disjointed basic and simple k/n, and eliminating a logical conjunction having a rank which is greater than the maximum rank of the minimal cut-set.
机译:本发明是一种故障树分析系统,其具有k / n门逻辑对合消除装置,用于消除包括不相交的基本和简单k / n的逻辑对合,并且消除具有大于最大等级的等级的逻辑对合最小割集。

著录项

  • 公开/公告号WO2012115007A1

    专利类型

  • 公开/公告日2012-08-30

    原文格式PDF

  • 申请/专利权人 NEC CORPORATION;XIANG JIANWEN;

    申请/专利号WO2012JP53826

  • 发明设计人 XIANG JIANWEN;

    申请日2012-02-17

  • 分类号G06F11/22;

  • 国家 WO

  • 入库时间 2022-08-21 17:14:05

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