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Fourier transform circuit, information processing apparatus, Fourier transform method, and Fourier transform program

机译:傅立叶变换电路,信息处理设备,傅立叶变换方法和傅立叶变换程序

摘要

PROBLEM TO BE SOLVED: To reduce power to be unnecessarily consumed by an FFT(Fast Fourier Transform) arithmetic circuit.SOLUTION: A stage calculation part 110 executes stage calculation of Fourier transform on input data 101 for a predetermined number of stages, to obtain arithmetic result data 102 every time the stage calculation is executed. A stop determination part 150 predicts a maximum value (final stage maximum value) of the arithmetic result data 102 after the final stage, on the basis of the arithmetic result data 102, for each stage calculation. The stop determination part 150 determines whether the final stage maximum value is smaller than a value of minimum value information 109, for each stage calculation. When the final stage maximum value is smaller than the value of the minimum value information 109, the stop determination part 150 outputs a stop signal 105, and stops operation of the stage calculation part 110 and a RAM part 120. When the stop signal 105 is output, a clip part 160 outputs a predetermined output value "zero" as output data 106.
机译:解决的问题:为了减少FFT(快速傅里叶变换)算术电路不必要地消耗的功率。解决方案:阶段计算部分110对输入数据101执行傅里叶变换的阶段计算预定级数,以获得算术每当执行阶段计算时,结果数据102。停止确定部分150基于算术结果数据102针对每个阶段计算来预测最后一级之后的算术结果数据102的最大值(最终最大值)。停止确定部分150针对每个阶段计算确定最终阶段最大值是否小于最小值信息109的值。当最终阶段最大值小于最小值信息109的值时,停止确定部分150输出停止信号105,并且停止阶段计算部分110和RAM部分120的操作。在输出时,限幅器部分160输出预定的输出值“零”作为输出数据106。

著录项

  • 公开/公告号JP5822791B2

    专利类型

  • 公开/公告日2015-11-24

    原文格式PDF

  • 申请/专利权人 三菱電機株式会社;

    申请/专利号JP20120137867

  • 发明设计人 鈴木 弘一;

    申请日2012-06-19

  • 分类号G06F17/14;G06F1/32;

  • 国家 JP

  • 入库时间 2022-08-21 14:40:02

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