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Leading zero anticipation

机译:领先零期待

摘要

A data processing apparatus is provided. Intermediate value generation circuitry generates an intermediate value from a first floating point number and a second floating point number. The intermediate value includes a number of leading 0s indicative of a prediction of a number of leading 0s in a difference between absolute values of the first floating point number and the second floating point number. The prediction differs by at most one from the number of leading 0s in the difference between absolute values of the first floating point number and the second floating point number. Count circuitry counts the number of leading 0s in said intermediate value and mask generation circuitry produces one or more masks using the intermediate value. The mask generation circuitry produces the one or more masks at the same time or before the count circuitry counts the number of leading 0s in the intermediate value.
机译:提供了一种数据处理设备。中间值生成电路从第一浮点数和第二浮点数生成中间值。中间值包括指示在第一浮点数和第二浮点数的绝对值之间的差中的前导0的数目的预测的前导0的数目。在第一浮点数和第二浮点数的绝对值之差中,预测与前导0的数量最多相差一个。计数电路对所述中间值中的前导0的数目进行计数,并且掩码生成电路使用该中间值来产生一个或多个掩码。掩码生成电路会同时或在计数电路对中间值中的前导0进行计数之前生成一个或多个掩码。

著录项

  • 公开/公告号GB2559039B

    专利类型

  • 公开/公告日2019-06-05

    原文格式PDF

  • 申请/专利权人 ARM LIMITED;

    申请/专利号GB20170020229

  • 发明设计人 DAVID RAYMOND LUTZ;

    申请日2017-12-05

  • 分类号G06F7/485;G06F7/499;G06F7/74;

  • 国家 GB

  • 入库时间 2022-08-21 11:43:16

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