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Method and system for measuring pattern placement error on a wafer

机译:用于测量晶片上的图案放置误差的方法和系统

摘要

A method for measuring pattern placement error (PPE) on a wafer includes receiving a photomask pattern. One or more unit cell patterns are added to the photomask pattern. Each of the unit cell patterns includes at least one reference design pattern and at least one PPE check design pattern. A photomask is fabricated from the photomask pattern with the one or more unit cell patterns added thereto. A wafer is patterned using the fabricated photomask. A microscope image of the patterned wafer is acquired. Pattern placement error is measured as a displacement between the at least one reference design pattern and the at least one PPE check design pattern.
机译:一种用于测量晶片上的图案放置误差(PPE)的方法,包括接收光掩模图案。将一个或多个单位晶格图案添加到光掩模图案中。每个单位单元图案包括至少一个参考设计图案和至少一个PPE检查设计图案。由光掩模图案制造光掩模,并向其添加一个或多个单位晶格图案。使用制造的光掩模对晶片进行构图。获取图案化晶片的显微镜图像。图案放置误差被测量为至少一种参考设计图案和至少一种PPE检查设计图案之间的位移。

著录项

  • 公开/公告号US10748821B2

    专利类型

  • 公开/公告日2020-08-18

    原文格式PDF

  • 申请/专利权人 SAMSUNG ELECTRONICS CO. LTD.;

    申请/专利号US201815863041

  • 发明设计人 GYEONGSEOP KIM;

    申请日2018-01-05

  • 分类号H01L21/66;H01L21/027;H01L27/02;G03F1/44;G03F7/20;G06F30/20;G06F30/392;

  • 国家 US

  • 入库时间 2022-08-21 11:31:03

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