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System and method of floating point multiply operation processing

机译:浮点乘法运算处理的系统和方法

摘要

A processor includes an integer multiplier configured to execute an integer multiply instruction to multiply significand bits of at least one floating point operand of a floating point multiply operation. The processor also includes a floating point multiplier configured to execute a special purpose floating point multiply accumulate instruction with respect to an intermediate result of the floating point multiply operation and the at least one floating point operand to generate a final floating point multiplication result.
机译:一种处理器,包括整数乘法器,该整数乘法器被配置为执行整数乘法指​​令以对浮点乘法运算的至少一个浮点操作数的有效位进行乘法。该处理器还包括浮点乘法器,该浮点乘法器被配置为相对于浮点乘法操作和至少一个浮点操作数的中间结果执行专用浮点乘法累加指令,以生成最终的浮点乘法结果。

著录项

  • 公开/公告号AU2018388451A1

    专利类型

  • 公开/公告日2020-06-11

    原文格式PDF

  • 申请/专利权人 QUALCOMM INCORPORATED;

    申请/专利号AU20180388451

  • 发明设计人 DANYSH ALBERT;PLONDKE ERICH;MAHURIN ERIC;

    申请日2018-12-11

  • 分类号G06F7/523;G06F7/53;

  • 国家 AU

  • 入库时间 2022-08-21 11:12:11

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