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基于网络处理器的流相关控制信息高速缓冲存储器

摘要

基于网络处理器的流相关控制信息高速缓冲存储器属于计算机技术领域,其特征在于:地址空间被划分为相同大小的块,每个流对应于一个块,用来保存该流的控制信息;Flow-Cache设置了两个称为BankA和Bank B的工作栈,工作栈中的缓存数据也组织为块的形式;在处理单元在使用一个工作栈中的流相关控制信息进行处理的时候,另外一个工作栈通过流分类器提供的预取地址为下一个数据包读入相关的流相关控制信息;如果流相关控制信息被处理单元修改,当发生替换时,需要将被修改的部分写回控制信息存储器。本发明能使用SDRAM等大容量低成本的存储器件来完成较为复杂的网络功能,减少对网络处理器存储器带宽的占用,并兼顾网络处理器对于性能确定性的需求。

著录项

  • 公开/公告号CN100508497C

    专利类型发明授权

  • 公开/公告日2009-07-01

    原文格式PDF

  • 申请/专利权人 清华大学;

    申请/专利号CN200610011424.3

  • 发明设计人 刘祯;刘斌;

    申请日2006-03-03

  • 分类号H04L12/56(20060101);

  • 代理机构

  • 代理人

  • 地址 100084 北京市北京100084-82信箱

  • 入库时间 2022-08-23 09:02:47

法律信息

  • 法律状态公告日

    法律状态信息

    法律状态

  • 2017-04-19

    未缴年费专利权终止 IPC(主分类):H04L 12/56 授权公告日:20090701 终止日期:20160303 申请日:20060303

    专利权的终止

  • 2009-07-01

    授权

    授权

  • 2006-09-27

    实质审查的生效

    实质审查的生效

  • 2006-08-02

    公开

    公开

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