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用于将源同步数据路径与未知时钟相位对接的数据桥

摘要

本公开的实施例涉及用于将源同步数据路径与未知时钟相位对接的数据桥。集成电路包括第一子系统,第一子系统包括被配置为生成第一时钟信号的第一时钟发生器。集成电路还包括第二子系统,第二子系统包括被配置为生成第二时钟信号的第二时钟发生器。第一子系统包括时钟边沿选择器,时钟边沿选择器被配置为确定在第一时钟信号和第二时钟信号之间的相位差并且基于相位差,选择第二时钟信号的上升边沿或下降边沿来控制从第一子系统输出到第二子系统的数据。

著录项

  • 公开/公告号CN114691583A

    专利类型发明专利

  • 公开/公告日2022-07-01

    原文格式PDF

  • 申请/专利权人 意法半导体国际有限公司;

    申请/专利号CN202111638418.1

  • 发明设计人 A·巴尔;R·辛格;

    申请日2021-12-29

  • 分类号G06F13/42;G06F13/40;

  • 代理机构北京市金杜律师事务所;

  • 代理人黄海鸣

  • 地址 瑞士日内瓦

  • 入库时间 2023-06-19 15:50:55

法律信息

  • 法律状态公告日

    法律状态信息

    法律状态

  • 2022-07-01

    公开

    发明专利申请公布

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