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延迟锁相回路装置及其更新方法

摘要

本发明提供一种延迟锁相回路装置以及用于延迟锁相回路的更新方法。延迟锁相回路装置包括延迟锁相回路以及更新电路。延迟锁相回路依据致能信号被致能,藉以对输入时钟进行延迟以提供延迟时钟。更新电路包括旗标产生电路以及致能电路。旗标产生电路基于预设时间区间提供更新旗标。致能电路依据更新旗标以将致能信号触发至第一逻辑电平,并在预设时间区间结束前将致能信号由第一逻辑电平转态至第二逻辑电平。默认时间区间小于内存的刷新周期。

著录项

  • 公开/公告号CN113808634A

    专利类型发明专利

  • 公开/公告日2021-12-17

    原文格式PDF

  • 申请/专利权人 华邦电子股份有限公司;

    申请/专利号CN202010528249.5

  • 发明设计人 奥野晋也;

    申请日2020-06-11

  • 分类号G11C7/22(20060101);G11C11/4076(20060101);

  • 代理机构11205 北京同立钧成知识产权代理有限公司;

  • 代理人朱颖;刘芳

  • 地址 中国台湾台中市大雅区科雅一路8号

  • 入库时间 2023-06-19 13:45:04

法律信息

  • 法律状态公告日

    法律状态信息

    法律状态

  • 2022-01-04

    实质审查的生效 IPC(主分类):G11C 7/22 专利申请号:2020105282495 申请日:20200611

    实质审查的生效

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