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公开/公告号CN113540073A
专利类型发明专利
公开/公告日2021-10-22
原文格式PDF
申请/专利权人 三星电子株式会社;
申请/专利号CN202110423684.6
发明设计人 白尚训;孔贞顺;都桢湖;
申请日2021-04-20
分类号H01L27/02(20060101);H01L29/06(20060101);H01L29/10(20060101);
代理机构11105 北京市柳沈律师事务所;
代理人屈玉华
地址 韩国京畿道
入库时间 2023-06-19 12:56:12
法律状态公告日
法律状态信息
法律状态
2023-05-09
实质审查的生效 IPC(主分类):H01L27/02 专利申请号:2021104236846 申请日:20210420
实质审查的生效
机译: 集成电路,包括垂直通道结构和相同的布局方法
机译: 作为形成集成电路的垂直型晶体管的方式,该垂直型晶体管包括集成电路结构,并且至少具有具有方式的垂直管芯晶体管DRAM电解池和具有方式的垂直管芯晶体管以及构成方式的DRAM。
机译:模拟集成电路中与公共重心对应的布局方法研究
机译:单片微波集成电路的布局方法
机译:量子阱倒置沟道异质结构作为光电集成电路的多功能组件
机译:绝缘体上有效沟道长度为5-18nm的Si,Ge和Si_(1-x)Ge_x垂直双载流子场效应晶体管集成电路的器件物理和设计理论
机译:基于N沟道InGaAsP-InP的倒置通道技术器件(ICT)的设计,制造和表征,用于光电集成电路(OEIC):双异质结光电开关(DOES),异质结场效应晶体管(HFET),双极倒置沟道场-效应晶体管(BICFET)和双极型反向沟道光电晶体管(BICPT)。
机译:早期酒精暴露对视觉触觉集成电路功能组织和微结构的影响
机译:针对三维集成电路的综合布局方法和特定于布局的电路分析
机译:采用n和p沟道mOs Fet的数字子系统的设计和开发在集成电路阵列的互补电路中最终报告,1967年5月1日 - 1968年4月30日