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公开/公告号CN113114226A
专利类型发明专利
公开/公告日2021-07-13
原文格式PDF
申请/专利权人 北京理工大学;
申请/专利号CN202110582774.X
发明设计人 曹杰;郝群;李国梁;伍子雄;徐辰宇;鲍春;
申请日2021-05-26
分类号H03L7/08(20060101);H03L7/18(20060101);
代理机构11639 北京正阳理工知识产权代理事务所(普通合伙);
代理人邬晓楠
地址 100081 北京市海淀区中关村南大街5号
入库时间 2023-06-19 11:49:09
法律状态公告日
法律状态信息
法律状态
2023-02-21
授权
发明专利权授予
机译: 一种具有多个基于FPGA的硬件加速器块的测试架构,可独立测试多个时间
机译: DUT FPGA一种测试架构,具有基于FPGA的硬件加速器模块,可独立测试多个器件
机译:使用混合数系统的数字信号处理器MAC单元FPGA实现的FPGA新架构
机译:借助混合多处理和FPGA来提高系统性能:多处理正成为基于FPGA的处理器架构的关键差异化因素
机译:基于敏捷和基于FPGA的并发三频全数字RF传输的实时架构
机译:一种新的基于FPGA的后处理器架构,用于频道不匹配时间校正时间交错ADC
机译:CoRAM:一种用于基于FPGA的计算的结构内存储器架构。
机译:一种新颖的基于注意力的混合CNN-RNN架构,用于基于sEMG的手势识别
机译:一种可配置的架构,用于在低密度FPGA中运行混合卷积神经网络的可配置架构
机译:基于Tms320C25的混合数字锁相环的设计与实现 - 一种应用于转发器接收器面板的应用