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用于具有下一比特表的存储器单元的刷新方案

摘要

存储器刷新控制技术允许基于外部1倍刷新率的灵活内部刷新率以及允许跳过基于外部1倍刷新率的针对强存储器行的刷新循环。存储器控制器通过从刷新地址计数器中读取刷新地址、从弱地址表中读取弱地址以及至少部分地基于与弱地址组合的下一比特序列来生成下一弱地址值来执行存储器刷新。存储器控制器将刷新地址与弱地址以及与下一弱地址值进行比较。基于该比较,存储器控制器在跳过刷新循环、刷新刷新地址、刷新弱地址、以及刷新刷新地址和弱地址两者之间进行选择。

著录项

  • 公开/公告号CN105814639A

    专利类型发明专利

  • 公开/公告日2016-07-27

    原文格式PDF

  • 申请/专利权人 高通股份有限公司;

    申请/专利号CN201480066948.5

  • 发明设计人 X·董;J·P·金;J·徐;

    申请日2014-11-20

  • 分类号G11C11/406(20060101);

  • 代理机构31100 上海专利商标事务所有限公司;

  • 代理人亓云

  • 地址 美国加利福尼亚州

  • 入库时间 2023-06-19 00:09:35

法律信息

  • 法律状态公告日

    法律状态信息

    法律状态

  • 2019-05-14

    专利权的视为放弃 IPC(主分类):G11C11/406 放弃生效日:20190514 申请日:20141120

    专利权的视为放弃

  • 2016-08-24

    实质审查的生效 IPC(主分类):G11C11/406 申请日:20141120

    实质审查的生效

  • 2016-07-27

    公开

    公开

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