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集成电路设计的原理图的交互式简化

摘要

交互式成组工具提供通过将没有被列为感兴趣的电路元件成组为任何大小的实体来简化集成电路(IC)设计的电路图的灵活性。可以将各种类型和功能的电路元件(包括端口和管脚)组合起来成为同一实体而不修改底层设计逻辑和连接关系。通过成组并且隐藏不必要的细节,所述工具降低了电路图中的凌乱程度并且极大地方便了遍历、调试和分析电路图的处理。用户可以动态地选定成组电路图上的电路元件而不经过任何编译或综合处理。用户也可以选择用解组操作将任一实体恢复到最初的电路图。为了特殊地或批量操控电路图,所述工具为用户提供了输入命令的脚本界面。可以通过使用用于特定操作的拖放技术来改变选中的实体的内容,特定操作包括将节点移入实体、从实体中移走节点和将节点加入实体。

著录项

  • 公开/公告号CN101847169A

    专利类型发明专利

  • 公开/公告日2010-09-29

    原文格式PDF

  • 申请/专利权人 阿尔特拉公司;

    申请/专利号CN201010145108.1

  • 发明设计人 C·P·施恩;D·C·H·古;

    申请日2010-03-26

  • 分类号G06F17/50;G06F3/048;

  • 代理机构北京纪凯知识产权代理有限公司;

  • 代理人赵蓉民

  • 地址 美国加利福尼亚州

  • 入库时间 2023-12-18 00:52:30

法律信息

  • 法律状态公告日

    法律状态信息

    法律状态

  • 2015-11-25

    授权

    授权

  • 2012-05-09

    实质审查的生效 IPC(主分类):G06F17/50 申请日:20100326

    实质审查的生效

  • 2010-09-29

    公开

    公开

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