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机译:逻辑重新布线以实现延迟和功耗最小化
Department of Electrical and Computer Engineering and Department of Computer Science University of Toronto Toronto, Ontario M5S 3G4, Canada;
VLSI; logic optimization; low power; design performance; diagnosis;
机译:ReMap:一种新颖的基于自动窥孔优化的逻辑,延迟和功耗最小化方法
机译:基于模糊逻辑的瞬时功率纹波最小化,用于分流有源电力滤波器中的直接功率控制
机译:调度电池供电的传感器网络以最大程度地减少检测延迟
机译:重新设计以最小化功耗逻辑设计
机译:低功耗FinFET逻辑电路和架构的延迟/功率建模和优化技术。
机译:具有实际门延迟模型的CMOS组合逻辑电路的准确动态功率估算
机译:二级结构的延迟最小化和技术映射以及使用时钟延迟Domino逻辑的实现