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机译:在基于内核的片上系统测试中处理无用的测试数据
Dept. of Electron. & Comput. Sci., Univ. of Southampton, UK;
integrated circuit testing; system-on-chip; boundary scan testing; production testing; automatic testing; logic testing; useless test data; core-based system-on-a-chip test; test memory requirements; padding bits; chains; multiple scan chain designs; test bus width; multiple scan chain-based cores; test access mechanism; test time; test data; test methodology; wrapper scan chains;
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