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机译:用于组合电路中路径延迟故障的全速鲁棒测试的模拟器
机译:使用测试点的大型组合电路中路径延迟故障的可测试性设计
机译:关于检测组合逻辑电路中所有路径延迟故障的测试次数
机译:用于两轨逻辑电路的鲁棒路径延迟故障测试的测试仪
机译:基于功能特性的鲁棒路径延迟故障可测试组合电路设计
机译:测试同步数字电路中的路径延迟故障。
机译:故障的鲁棒性促进了可扩展性:不断发展的数字电路的见解
机译:使用测试点的大型组合电路的路径延迟故障的可测试性设计
机译:组合逻辑电路的最小故障测试时序设计和可测试实现