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A Systolic Array-Based FPGA Parallel Architecture for the BLAST Algorithm

机译:用于BLAST算法的基于脉动阵列的FPGA并行架构

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摘要

A design of systolic array-based Field Programmable Gate Array (FPGA) parallel architecture for Basic Local Alignment Search Tool (BLAST) Algorithm is proposed. BLAST is a heuristic biological sequence alignment algorithm which has been used by bioinformatics experts. In contrast to other designs that detect at most one hit in one-clock-cycle, our design applies a Multiple Hits Detection Module which is a pipelining systolic array to search multiple hits in a single-clock-cycle. Further, we designed a Hits Combination Block which combines overlapping hits from systolic array into one hit. These implementations completed the first and second step of BLAST architecture and achieved significant speedup comparing with previously published architectures.
机译:提出了一种基于脉动阵列的现场局部门禁搜索工具(BLAST)算法的现场可编程门阵列(FPGA)并行架构设计。 BLAST是一种启发式生物序列比对算法,已被生物信息学专家使用。与其他设计在一个时钟周期内最多只能检测到一个命中的其他设计相比,我们的设计采用了多个命中检测模块,该模块是流水式脉动阵列,可以在一个时钟周期内搜索多个命中。此外,我们设计了一个命中组合块,将收缩压阵列中的重叠命中组合为一个命中。这些实现完成了BLAST体系结构的第一步和第二步,与以前发布的体系结构相比,实现了显着的加速。

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