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准规则Q矩阵LDPC码编码器设计

         

摘要

设计了一种准规则Q矩阵LDPC码编码器.该编码器基于准规则Q矩阵LDPC码的校验矩阵,其编码复杂度与信息位的长度成正比,有效降低了编码复杂度和设计难度.在Quartus Ⅱ平台上用FPGA实现了该编码器,结果证明其硬件资源占用很少.

著录项

  • 来源
    《电视技术》 |2007年第11期|19-21|共3页
  • 作者

    姜慧源; 田斌; 易克初;

  • 作者单位

    西安电子科技大学,综合业务网理论及关键技术国家重点实验室,陕西,西安,710071;

    西安电子科技大学,综合业务网理论及关键技术国家重点实验室,陕西,西安,710071;

    西安电子科技大学,综合业务网理论及关键技术国家重点实验室,陕西,西安,710071;

  • 原文格式 PDF
  • 正文语种 chi
  • 中图分类 信道编码理论;
  • 关键词

    LDPC码; 编码器; Q矩阵; 奇偶校验矩阵;

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