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谢凯元;
杭州电子科技大学电子信息学院,浙江杭州310018;
FDTD; 硬件加速计算; FPGA;
机译:基于FPGA的定制计算机加速有限时域(FDTD)计算的性能评估
机译:基于FPGA的片上系统设计的矩阵转换器保护和计算能力
机译:ASAver.1:用于计算机体系结构/系统设计的基于FPGA的教学板
机译:基于FPGA的车载计算系统技术演示器的小型卫星飞行膝上型计算机的系统设计
机译:基于FPGA的加速器的最佳设计空间探索:以一维FDTD为例。
机译:基于FPGA的折衷分析在存在不良状态和计算中不同的精度水平
机译:基于FPGA的自定义计算机加速有限差分时域(FDTD)计算的性能评估
机译:二维时域有限差分(FDTD)算法的FpGa实现
机译:FDTD计算装置及FDTD计算方法
机译:通过组合基于fpgas的数字加速器和基于对象的界面来设计通用高性能计算机应用程序的方法
机译:控制系统设计辅助装置,控制系统设计辅助程序,控制系统设计辅助方法,操作变化量计算装置及控制装置
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