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一种RS码译码器的硬件实现方法

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提出了一种RS系统码译码器的硬件实现结构.译码器采用时域译码算法,主要包括有限域并行乘法器、BM迭代算法、适合于缩短码的钱氏搜索算法、错误值计算的硬件电路,其运算结构规则,具有一定的通用性,因此适合于VLSI实现.

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来源
《无线电通信技术》 |2004年第1期|9-1048|共3页
作者
王伟; 徐辉; 邹火儿;
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作者单位

中国电子科技集团公司第54研究所,石家庄,050002;

中国电子科技集团公司第54研究所,石家庄,050002;

中国电子科技集团公司第54研究所,石家庄,050002;

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正文语种 chi
中图分类计算机的应用 ;
关键词
RS码 BM叠代算法编码器译码器;

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