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王志莹; 王子斌;
电子科技大学自动化工程学院;
Altera现场可编程门阵列; Quartus; Ⅱ软件; 逻辑锁定; 约束编辑器; 时序收敛;
机译:在时序约束下实现最小能量的许多 $ V_ {t} $ tex> formula> CMOS工艺的快速ULV逻辑综合流程
机译:将软实时应用中的时序约束违规作为异常处理
机译:逻辑子网在拥塞感知到无锁定SDMESH路由中的应用
机译:神经网络在高能物理中的应用:高速数据采集中的应用
机译:逻辑锁定框架及其在FPGA中安全启动的应用
机译:模糊逻辑在WSANS中的actor节点选择中的应用 - 基于模糊的系统和试验用的应用
机译:产科护理决策支持指南:模糊逻辑技术指南在产科护理中的应用决策:相对逻辑技术决策支持指南在产科护理中的应用:模糊逻辑技术的应用
机译:相干雷达应用的高速数据采集装置设计
机译:逻辑电路的时序约束模型的生成方法,逻辑电路的时序约束模型的生成程序以及使用时序约束模型的时序驱动布局方法
机译:逻辑电路的时序约束生成系统以及逻辑电路的时序约束生成方法,控制程序和可读记录介质
机译:用于生成逻辑电路的时序约束模型的方法和程序以及采用时序约束模型的时序驱动布局方法
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