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宣建华; 姚庆栋;
不详;
并行算法; 结构; Viterbi处理器;
机译:高速Viterbi处理器:脉动阵列解决方案
机译:具有线性加速功能的Viterbi解码器的多处理器体系结构
机译:多处理器逻辑结构中恢复环境的并行算法和功能组织
机译:多核密码处理器上哈希算法的并行算法高速实现
机译:高速Viterbi解码器设计和FPGA实现。
机译:GPU处理的并行算法;用于棉绒垃圾的高速机器视觉传感
机译:将Viterbi算法移植到多处理器体系结构
机译:用于Reed-muller子码的高速Viterbi译码器的体系结构和实现考虑
机译:数字信号处理器(Viterbi)通道解码中的Viterbi和Turbo通道解码性能
机译:Viterbi存储器ACS最佳结构的解码器(Viterbi解码器中ACS的存储器的最佳结构)
机译:通过P并行算法处理P列和P行之后的数据解码的高速编码解码算法
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