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宋廷强; 刘川来; 周艳;
青岛科技大学信息与控制工程学院;
青岛科技大学机电工程学院;
SoC; WISHBONE; IP核; 片上总线; 系统集成芯片; 可重用设计;
机译:片上通信的故障模型,联合均衡以及片上总线设计的特殊间距规则
机译:用于高性能嵌入式SOC设计的可重新配置的片上互连网络
机译:GNLS:用于SoC设计的混合片上通信架构
机译:在SoC设计中从Wishbone总线移植到Avalon总线
机译:用于多处理器SoC设计的自动总线生成。
机译:3D打印的片上实验室诊断系统-开发一种设计安全的制造方法
机译:具有自动可配置总线生成功能的SoC设计环境,用于快速原型设计
机译:通用处理器的片上总线互连可信设计方法。
机译:SOC的4Less-Xtaless,capless,indless,dioless TSOC设计或SOC 4Free-SOCltal,Xtalfree,capless,indfree,diofree TSOC设计
机译:SOC的4Less-Xtaless,capless,indless,dioless TSOC设计或SOC 4Free-Xtalfree,capless,indfree,diofree TSOC设计
机译:具有互连开关点的片上总线体系结构,使用其的半导体器件以及在片上总线体系结构中传输数据的方法
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