USB IP Core的Verilog HDL语言设计方法

凌朝东; 刘蓉; 林春德; 戴在平

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USB IP Core的Verilog HDL语言设计方法

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通用串行总线(USB)作为一种崭新的微机总线接口规范,具有即插即用、扩展方便等优点,已成为计算机必备的一个接口.采用VerilogHDL语言设计USB IP Core,分析时序设计要点.实现对主机发送的标准设备请求,返回设备描述符、传送数据等操作,并在MaxplusⅡ环境下进行了波形仿真和时序分析.时序仿真满足设计要求.

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来源
《莆田学院学报》 |2002年第3期|48-52|共5页
作者
凌朝东; 刘蓉; 林春德; 戴在平;
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作者单位

华侨大学信息科学与工程学院,福建,泉州,362011;

华侨大学信息科学与工程学院,福建,泉州,362011;

华侨大学信息科学与工程学院,福建,泉州,362011;

华侨大学信息科学与工程学院,福建,泉州,362011;

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原文格式 PDF
正文语种 chi
中图分类接口装置、插件;
关键词
IP Core; USB接口; Verilog HDL语言; 标准设备描述符;

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