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高娜娜; 王沁; 李占才;
北京科技大学,信息工程学院,北京,100083;
可重构S盒; 密码芯片; AES算法; DES算法;
机译:基于流水线结构的可重构AES算法IP核的硬件实现
机译:基于流水线结构的可重构AES算法IP核的硬件实现(英文)
机译:紧凑型AES S盒的硬件实现
机译:使用压缩AES硬件实现中的流水线S盒
机译:带有可重新配置S盒的高速DES实现,用于基于FPGA的新兴网络应用。
机译:集成可重构的基于硬件的网格以实现高性能计算
机译:FPGA利用AES加密器使用子流水线S盒技术实现硬件架构,用于紧凑型应用
机译:屏蔽紧凑型aEs s盒
机译:AES Rijndael密码算法的硬件实现的AES Rijndael回合处理电路和在线回合密钥生成电路
机译:基于终端硬件重构的通信实现方法和基站
机译:基于终端设备硬件重构的基站及通信实现方法
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