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段铁; 黄焱; 汪洋;
信息工程大学信息系统工程学院;
河南郑州450000;
重构; 数字锁相环; 载波同步; 组件; OCP; FPGA;
机译:使用一阶数字锁相环进行2(4)-PSK调制的载波同步性能
机译:基于电荷泵锁相环类比的全数字锁相环设计程序
机译:具有数字锁相环的突发模式载波同步
机译:低抖动,宽锁定范围全数字锁相环和延迟锁相环的研究和设计。
机译:基于级联时间插值器的可重构时间数字转换器的电阻抗谱设计†
机译:多速率数字滤波器组在宽带全数字锁相环设计中的应用
机译:数字锁相环(DPLL),用于控制数字锁相环(DPLL)中的抖动的方法,用于优化数控振荡器(DCO)中的抖动的方法以及自抖动数字控制振荡器(DCO)电路
机译:锁相环,用于与智能信号中包含的子载波同步
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