CMOS缓冲器的时延估算模型

摘要

随着集成电路生产工艺的进展,互连线在集成电路设计中的影响越来越大。为了减小互连线的影响,通常在芯片互连中插入缓冲器,但这样做会增加时延。因此,为了精确地对系统进行时延估计,必须对缓冲器的时延进行估算。基于Sakurai的器件模型,提出了一种新的缓冲器时延估算模型。