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江浩;
北京邮电大学;
时钟信号; 印刷电路板; 特性阻抗;
机译:两阶段正弦功率时钟和时钟传输门的绝热逻辑电路设计
机译:VLSI电路设计中的动态时钟展宽用于变化补偿
机译:高速串行传输中编码与时钟传输方法的信号光谱及时钟抖动影响
机译:具有四分之一速率时钟定时的判决反馈均衡,用于高速背板数据通信
机译:高速动态电路设计和时钟技术。
机译:高速调频原子力显微镜的宽带低延迟锁相环电路设计的定量比较
机译:高速SOCS时钟占空比校正电路设计
机译:背板总线分布式实时时钟同步
机译:设计电路系统,扩展现有方法以评估电路设计的可行性,执行电路设计的可行性评估,完善电路设计的第一决策规则,形成电路设计的第二决策规则的方法电路设计,用于为多个预先设计的电路块组织设计者的经验数据,提高胶粘逻辑分配效率,并在设计块之间分配胶粘的多个逻辑元素,并分配胶粘逻辑以在集成电路设备设计中执行方案,转换特定于电路块的接口,选择电路收集器,设计一种包含使能设备测试以验证a正确操作的设备,并开发行为测试台,项圈接口和接口系统
机译:使用相反的时钟边沿触发触发器的电路设计中的时序优化
机译:在集成电路设计中自动管理时钟关系的系统和方法
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