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1μm高速CMOS容错时钟接收器电路的研制

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采用新的设计规则与先进的自对准硅化钛LDD CMOS工艺,研制成功了相当于1386主频的1μm、25MHz高速容错时钟接收器电路.

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来源
《微电子学与计算机》 |1993年第7期|38-39|共2页
作者
余山; 章定康; 杨樱华; 黄敞;
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作者单位

航空航天部骊山微电子学研究所;

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原文格式 PDF
正文语种 chi
中图分类 TN432.02;
关键词
电路设计; 容错; 时钟; 接收器; CMOS;

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