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基于DVB-C的符号同步电路优化设计

     

摘要

根据DVB-C标准,采用反馈环路实现符号同步,其中时钟误差检测器选择M&M算法.通过复用将符号同步电路中时钟误差检测器和环路滤波器的乘法器数目由六个减少到两个,减少了硬件规模.通过对所设计的符号同步环路仿真,环路能够在采样时钟抖动为200×10-6时完成对64QAM(正交幅度调制)信号的符号同步,并能在较短时间内达到收敛.

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