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基于FPGA实现改进CORDIC算法研究

         

摘要

传统的CORDIC算法虽然能提高相位分辨率,但是硬件资源的消耗量很大,为了解决这个问题,对传统的CORDIC算法进行了改进,主要增加了内部相位累加器的位数,同时使用两位的方向控制因子改进下级流水操作的加减,在同等硬件资源的消耗量的情况下实现了更高相位分辨率的正余弦信号的产生。通过QuartusⅡ和MATLAB验证了系统的可行性。%Traditional CORDIC algorithm can improve the phase resolution, but consume considerable hardware resources. To solve this problem,the conventional CORDIC algorithm,in the great majority of cases,increases the medians in the internal phase accumulator,at the same time using the two-direction control factor to the lower pipeline addition and subtraction operations, and in the case of the same hardware resources consumption to achieves a higher phase resolution of the sine and cosine signal generation. The feasibility of the system is verified by QuartusⅡand MATLAB.

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