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张立国; 黄文汉; 金梅;
燕山大学电气工程学院;
现场可编程门阵列(FPGA); 卷积神经网络(CNN); 硬件加速器; 并行度;
机译:实时情绪识别系统中快速统计卷积神经网络的FPGA加速器架构分析
机译:基于FPGA的节能可重新配置卷积神经网络加速器,用于对象识别应用
机译:优化卷积神经网络加速器低成本FPGA
机译:基于数据优化的基于FPGA的卷积神经网络加速器的实现
机译:基于FPGA的嵌入式设备卷积神经网络的加速器
机译:FPGA实现气味识别与深度可分离的卷积神经网络
机译:情绪识别系统中卷积神经网络FPGA加速器架构的实现
机译:用于fpga实现的通信信号恢复的高功率雷达干扰减轻技术。
机译:生成时钟信号,以实现基于周期的,可重复的基于FPGA的FPGA硬件加速器
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