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王猛; 崔文涛; 田书林;
电子科技大学自动化学院,四川,成都,610054;
同步时钟; CDCF5801; 信号完整性; 阻抗匹配;
机译:安森美半导体推出了针对高速,低功耗设计进行了优化的新型时钟和数据多路复用器设备
机译:注意时钟和输出总线以改善高速ADC设计
机译:具有ITU-T建议书的带有通道时间压缩的高速多路复用系统的基本特性:第1部分。准同步数字体系第一层的多路复用系统的基本特性
机译:数字同步设计上模具高速时钟信号的抖动行为及表征
机译:在高速串行链路收发器中使用前端多路复用器/多路分解器的直接调制来进行精确的时钟合成。
机译:昼夜肝细胞时钟保持同步在不缺席核心核或其他侵略性时钟的情况下保持同步
机译:高速数字系统中同步流水线乘法器的设计和时钟偏斜分析
机译:高速数字系统中同步流水线乘法器的设计及时钟偏差分析
机译:用于在数据处理器中的不同时钟区域之间交换时钟数据的数据同步设备使用缓冲存储器,该缓冲存储器具有与各个时钟同步的写入选择多路复用器和读出选择多路复用器
机译:针对同步和异步时钟优化的无毛刺时钟多路复用器的设计结构
机译:指针生成器设计提供了多个输出,这些输出可以同步到不同的时钟
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