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应用于TDC的延迟锁相环研究与设计

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第1章 绪论

1.1 研究背景及意义

1.2 国内外研究现状

1.3 论文主要工作及设计目标

1.4 本文组织结构

第2章 延迟锁相环的基本原理介绍

2.1 鉴相器

2.2 电荷泵

2.3 环路滤波器

2.4 压控延迟线

2.5 本章小结

第3章 DLL系统分析与建模

3.1 DLL的小信号模型

3.2 DLL时钟抖动和噪声

3.3 DLL锁定范围

3.4 DLL参数设计

3.5 DLL的建模

3.6 本章小结

第4章 DLL的功能子模块设计

4.1 鉴相器电路设计

4.2 电荷泵电路设计

4.3 环路滤波器电路设计

4.4 压控延迟线电路设计

4.5 本章小结

第5章 DLL系统设计与验证

5.1 DLL整体电路设计

5.2 物理版图设计与后仿真验证

5.3 本章小结

第6章 工作总结与展望

6.1 工作总结

6.2 工作展望

参考文献

致谢

攻读硕士学位期间从事的科研工作及取得的成果

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著录项

  • 作者

    王道明;

  • 作者单位

    重庆邮电大学;

  • 授予单位 重庆邮电大学;
  • 学科 集成电路工程
  • 授予学位 硕士
  • 导师姓名 周前能;
  • 年度 2020
  • 页码
  • 总页数
  • 原文格式 PDF
  • 正文语种 chi
  • 中图分类 TN9TN8;
  • 关键词

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