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声明
1绪论
1.1研究背景及其意义
1.2数字化调制解调技术的现状发展及应用
1.3 FPGA的发展以及设计流程
1.4本文主要研究内容与结构
2调制解调方案的选取及实现平台
2.1调制解调方案的比较及选取
2.1.1 2PSK和2DPSK
2.1.2 QDPSK,OQPSK与π/4QPSK
2.1.3方案确定
2.2 QDPSK调制解调算法
2.3系统开发语言Verilog HDL简介
2.4 Altera公司的Quartus Ⅱ6.0开发平台
2.4.1 Quartus Ⅱ6.0开发平台简介
2.4.2 Quartus Ⅱ6.0的开发流程
2.5本章小节
3系统方案设计及MATLAB的实现
3.1系统总体设计简介
3.1.1 QDPSK调制系统
3.1.2 QDPSK解调系统
3.2系统功能分析与模块划分
3.2.1系统模块图
3.2.2模块功能划分
3.2.1QDPSK调制模块
3.2.2 QDPSK解调模块
3.3 QDPSK调制系统的设计实现及MATLAB实现
3.3.1串/并转换器的设计与实现
3.3.2差分编码器的设计与实现
3.3.3数控振荡器(NCO)的设计与实现
3.3.4乘法器的设计与实现
3.4加高斯白噪声之后的信号
3.5解调系统设计与实现
3.5.1数字下变频模块的设计与实现
3.5.2同步模块的设计及实现
3.5.3抽样判决模块的设计与实现
3.5.4差分解码模块及并/转换串的设计与实现
3.6本章小节
4 QDPSK调制解调的C++实现
4.1概述
4.2 QDPSK调制解调系统的C++具体实现
4.2.1 C++调制功能的具体实现
4.2.2 C++解调功能的具体实现
4.2.3参数设置
4.2.4主要实现函数功能介绍
4.2.5实现结果
4.3本章小节
5 QDPSK调制解调器的Verilog HDL实现
5.1概述
5.1.1具体实现概述
5.1.2系统主要参数
5.2 QDPSK调制系统的Verilog HDL实现
5.2.1串/并转换模块
5.2.2差分编码器模块
5.2.3数控振荡器(NCO)模块
5.2.4载波调制模块
5.2.5 QDPSK调制系统的具体实现原理框图
5.3 QDPSK解调系统的Verilog HDL实现
5.3.1乘法器模块
5.3.2低通滤波器模块
5.3.3数控振荡器(NCO)模块
5.3.4同步模块
5.3.5抽样判决模块
5.3.6差分解码及并/串转换模块
5.3.7 QDPSK解调系统的具体实现原理框图
5.4系统调试总结
5.5本章小节
6结论及展望
6.1结论
6.2展望
致谢
参考文献