声明
摘要
1 绪论
1.1 研究背景
1.2 DBF处理器国内外研究动态
1.3 本文主要工作及论文结构
2 DBF处理器的设计与数字阵列雷达系统集成
2.1 DBF处理器设计
2.1.1 DBF处理器架构
2.1.2 高速收发模块设计
2.1.3 S_RapidIO接口设计
2.2 数字阵列雷达系统的集成
2.2.1 数字阵列雷达的系统组成
2.2.2 数字阵列雷达系统的工作流程
2.3 本章小结
3 DBF处理器的FPGA程序设计
3.1 DBF处理器功能与工作流程
3.2 DBF处理器FPGA程序实现框架
3.3 光纤接口数据帧格式定义
3.4 FPGA主要功能模块设计
3.4.1 数据流收发控制模块
3.4.2 预处理指令模块
3.4.3 数字波束形成模块
3.4.4 发射波束权值控制模块
3.4.5 波束指向控制模块
3.4.6 基带快拍数据采集模块
3.4.7 波束形成数据汇总模块
3.5 本章小结
4 DBF处理器性能测试与系统联调
4.1 DBF处理器性能测试
4.1.1 同时接收多波束方向图测试方法
4.1.2 方向图测试结果
4.1.3 接收波束扫描功能测试方法
4.1.4 接收波束扫描测试结果
4.2 系统联调测试
4.2.1 系统联调测试方法
4.2.2 系统联合测试流程
4.2.3 系统联调测试结果
4.3 本章小结
5 总结与展望
致谢
参考文献